Metodologi Pengetesan Sel-Sel Standar pada Rangkaian VLSI
Harry Sudibyo S.;
(Fakultas Teknik Universitas Indonesia, 1993)
|
ABSTRAK Penggunaan compiler untuk sel-sel terstruktur seperti RAM, ROM, PLA dan Multiplier sudah tidak asing lagi dalam perancangan pemakaian Integrated Circuit (IC) yang spesifik. Dalam makalah ini akan diuraikan secara garis besarnya saja tentang metodologi pengetesan circuit-circuit yang dibuat dari rangkaian sel-sel tersusun (Rangkaian IC). Unsur-unsur pokok dalam metodologi pengetesan ini adalah: Vector compilers yang merupakan penghasil test yang sesuai untuk rangkaian sel-sel tersusun. Strategi pemisahan (An isolation strategy) yang memperbolehkan pengetesan ini dapat diaplikasikan pada rangkaian blok fungsi. |
LP-Harry Sudibyo.pdf :: Unduh
|
No. Panggil : | LP-pdf |
Entri utama-Nama orang : | |
Entri tambahan-Nama badan : | |
Subjek : | |
Penerbitan : | [Place of publication not identified]: Fakultas Teknik Universitas Indonesia, 1993 |
Program Studi : |
Sumber Pengatalogan | LibUI ind rda |
Tipe Konten | text |
Tipe Media | computer |
Tipe Carrier | online resource |
Deskripsi Fisik | |
Lembaga Pemilik | Universitas Indonesia |
Lokasi | Perpustakaan UI, Lantai 3 |
No. Panggil | No. Barkod | Ketersediaan |
---|---|---|
LP-pdf | 09-19-213667721 | TERSEDIA |
Ulasan: |
Tidak ada ulasan pada koleksi ini: 20288497 |